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最終更新日：2025/11/30

例文

In our FPGA design class, we implemented a Wallace tree to speed up 32-bit integer multiplication.

FPGA設計の授業で、32ビット整数の乗算を高速化するために、2つの整数を乗算するデジタル回路の効率的なハードウェア実装を導入しました。

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In our FPGA design class, we implemented a Wallace tree to speed up 32-bit integer multiplication.

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名詞

(computing) An efficient hardware implementation of a digital circuit that multiplies two integers.

日本語の意味

二つの整数を乗算するためのデジタル回路の効率的なハードウェア実装（ウォレス木アルゴリズムとして知られる）

In our FPGA design class, we implemented a Wallace tree to speed up 32-bit integer multiplication.

FPGA設計の授業で、32ビット整数の乗算を高速化するために、2つの整数を乗算するデジタル回路の効率的なハードウェア実装を導入しました。

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